Classic Timing Analyzer report for cpu1
Sun Jun 10 17:31:13 2007
Quartus II Version 6.1 Build 201 11/27/2006 SJ Web Edition


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; Table of Contents ;
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  1. Legal Notice
  2. Timing Analyzer Summary
  3. Timing Analyzer Settings
  4. Clock Settings Summary
  5. Clock Setup: 'clock'
  6. tsu
  7. tco
  8. tpd
  9. th
 10. Timing Analyzer Messages



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; Legal Notice ;
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and other software and tools, and its AMPP partner logic 
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; Timing Analyzer Summary                                                                                                                                                                                        ;
+------------------------------+-------+---------------+------------------------------------------------+--------------------------------+--------------------------------+------------+----------+--------------+
; Type                         ; Slack ; Required Time ; Actual Time                                    ; From                           ; To                             ; From Clock ; To Clock ; Failed Paths ;
+------------------------------+-------+---------------+------------------------------------------------+--------------------------------+--------------------------------+------------+----------+--------------+
; Worst-case tsu               ; N/A   ; None          ; 3.807 ns                                       ; aluout[4]                      ; data_memory:dados|Read_data[0] ; --         ; clock    ; 0            ;
; Worst-case tco               ; N/A   ; None          ; 9.800 ns                                       ; registrador:regpc|Q[1]         ; pcsourceout[7]                 ; clock      ; --       ; 0            ;
; Worst-case tpd               ; N/A   ; None          ; 7.789 ns                                       ; aluout[1]                      ; regsourceout[1]                ; --         ; --       ; 0            ;
; Worst-case th                ; N/A   ; None          ; -1.859 ns                                      ; pcsourceout[3]                 ; registrador:regpc|Q[3]         ; --         ; clock    ; 0            ;
; Clock Setup: 'clock'         ; N/A   ; None          ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|rxin ; registrador:regrx|Q[0]         ; clock      ; clock    ; 0            ;
; Total number of failed paths ;       ;               ;                                                ;                                ;                                ;            ;          ; 0            ;
+------------------------------+-------+---------------+------------------------------------------------+--------------------------------+--------------------------------+------------+----------+--------------+


+------------------------------------------------------------------------------------------------------+
; Timing Analyzer Settings                                                                             ;
+-------------------------------------------------------+--------------------+------+----+-------------+
; Option                                                ; Setting            ; From ; To ; Entity Name ;
+-------------------------------------------------------+--------------------+------+----+-------------+
; Device Name                                           ; EP1S10F484C5       ;      ;    ;             ;
; Timing Models                                         ; Final              ;      ;    ;             ;
; Default hold multicycle                               ; Same as Multicycle ;      ;    ;             ;
; Cut paths between unrelated clock domains             ; On                 ;      ;    ;             ;
; Cut off read during write signal paths                ; On                 ;      ;    ;             ;
; Cut off feedback from I/O pins                        ; On                 ;      ;    ;             ;
; Report Combined Fast/Slow Timing                      ; Off                ;      ;    ;             ;
; Ignore Clock Settings                                 ; Off                ;      ;    ;             ;
; Analyze latches as synchronous elements               ; On                 ;      ;    ;             ;
; Enable Recovery/Removal analysis                      ; Off                ;      ;    ;             ;
; Enable Clock Latency                                  ; Off                ;      ;    ;             ;
; Number of source nodes to report per destination node ; 10                 ;      ;    ;             ;
; Number of destination nodes to report                 ; 10                 ;      ;    ;             ;
; Number of paths to report                             ; 200                ;      ;    ;             ;
; Report Minimum Timing Checks                          ; Off                ;      ;    ;             ;
; Use Fast Timing Models                                ; Off                ;      ;    ;             ;
; Report IO Paths Separately                            ; Off                ;      ;    ;             ;
+-------------------------------------------------------+--------------------+------+----+-------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary                                                                                                                                                             ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type     ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; clock           ;                    ; User Pin ; None             ; 0.000 ns      ; 0.000 ns     ; --       ; N/A                   ; N/A                 ; N/A    ;              ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'clock'                                                                                                                                                                                                                                     ;
+-------+------------------------------------------------+------------------------------------------+------------------------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period)                           ; From                                     ; To                                       ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-------+------------------------------------------------+------------------------------------------+------------------------------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|rxin           ; registrador:regrx|Q[0]                   ; clock      ; clock    ; None                        ; None                      ; 1.784 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.inicio  ; controle:unidade_controle|riin           ; clock      ; clock    ; None                        ; None                      ; 1.733 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.inicio  ; controle:unidade_controle|rxin           ; clock      ; clock    ; None                        ; None                      ; 1.730 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[1]                   ; registrador:regrx|Q[5]                   ; clock      ; clock    ; None                        ; None                      ; 1.675 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[1]                   ; registrador:regrx|Q[6]                   ; clock      ; clock    ; None                        ; None                      ; 1.675 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[1]                   ; registrador:regrx|Q[7]                   ; clock      ; clock    ; None                        ; None                      ; 1.675 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[3]                   ; registrador:regrx|Q[5]                   ; clock      ; clock    ; None                        ; None                      ; 1.575 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[3]                   ; registrador:regrx|Q[6]                   ; clock      ; clock    ; None                        ; None                      ; 1.575 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[3]                   ; registrador:regrx|Q[7]                   ; clock      ; clock    ; None                        ; None                      ; 1.575 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[4]                   ; registrador:regrx|Q[5]                   ; clock      ; clock    ; None                        ; None                      ; 1.549 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[4]                   ; registrador:regrx|Q[6]                   ; clock      ; clock    ; None                        ; None                      ; 1.549 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[4]                   ; registrador:regrx|Q[7]                   ; clock      ; clock    ; None                        ; None                      ; 1.549 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[0]                   ; registrador:regrx|Q[5]                   ; clock      ; clock    ; None                        ; None                      ; 1.548 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[0]                   ; registrador:regrx|Q[6]                   ; clock      ; clock    ; None                        ; None                      ; 1.548 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[0]                   ; registrador:regrx|Q[7]                   ; clock      ; clock    ; None                        ; None                      ; 1.548 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|pcin           ; registrador:regpc|Q[4]                   ; clock      ; clock    ; None                        ; None                      ; 1.497 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|pcin           ; registrador:regpc|Q[3]                   ; clock      ; clock    ; None                        ; None                      ; 1.497 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|pcin           ; registrador:regpc|Q[5]                   ; clock      ; clock    ; None                        ; None                      ; 1.497 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|pcin           ; registrador:regpc|Q[6]                   ; clock      ; clock    ; None                        ; None                      ; 1.497 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|pcin           ; registrador:regpc|Q[7]                   ; clock      ; clock    ; None                        ; None                      ; 1.497 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[2]                   ; registrador:regrx|Q[5]                   ; clock      ; clock    ; None                        ; None                      ; 1.489 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[2]                   ; registrador:regrx|Q[6]                   ; clock      ; clock    ; None                        ; None                      ; 1.489 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[2]                   ; registrador:regrx|Q[7]                   ; clock      ; clock    ; None                        ; None                      ; 1.489 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[1]                   ; registrador:regrx|Q[4]                   ; clock      ; clock    ; None                        ; None                      ; 1.476 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.inicio  ; controle:unidade_controle|pcin           ; clock      ; clock    ; None                        ; None                      ; 1.423 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[1]                   ; registrador:regrx|Q[3]                   ; clock      ; clock    ; None                        ; None                      ; 1.416 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[5]                   ; registrador:regrx|Q[7]                   ; clock      ; clock    ; None                        ; None                      ; 1.411 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[3]                   ; registrador:regrx|Q[4]                   ; clock      ; clock    ; None                        ; None                      ; 1.361 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[6]                   ; registrador:regrx|Q[7]                   ; clock      ; clock    ; None                        ; None                      ; 1.359 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[1]                   ; registrador:regrx|Q[2]                   ; clock      ; clock    ; None                        ; None                      ; 1.356 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[5]                   ; registrador:regrx|Q[6]                   ; clock      ; clock    ; None                        ; None                      ; 1.351 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[0]                   ; registrador:regrx|Q[4]                   ; clock      ; clock    ; None                        ; None                      ; 1.338 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.jal_ret ; controle:unidade_controle|pcin           ; clock      ; clock    ; None                        ; None                      ; 1.335 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.jal_ret ; controle:unidade_controle|pcsource[0]    ; clock      ; clock    ; None                        ; None                      ; 1.335 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[0]                   ; registrador:regrx|Q[0]                   ; clock      ; clock    ; None                        ; None                      ; 1.344 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.jal_ret ; controle:unidade_controle|riin           ; clock      ; clock    ; None                        ; None                      ; 1.331 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[0]                   ; registrador:regrx|Q[3]                   ; clock      ; clock    ; None                        ; None                      ; 1.278 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[2]                   ; registrador:regrx|Q[4]                   ; clock      ; clock    ; None                        ; None                      ; 1.277 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|pcin           ; registrador:regpc|Q[1]                   ; clock      ; clock    ; None                        ; None                      ; 1.235 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|pcin           ; registrador:regpc|Q[0]                   ; clock      ; clock    ; None                        ; None                      ; 1.235 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|pcin           ; registrador:regpc|Q[2]                   ; clock      ; clock    ; None                        ; None                      ; 1.235 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|rxin           ; registrador:regrx|Q[4]                   ; clock      ; clock    ; None                        ; None                      ; 1.220 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|rxin           ; registrador:regrx|Q[5]                   ; clock      ; clock    ; None                        ; None                      ; 1.220 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|rxin           ; registrador:regrx|Q[6]                   ; clock      ; clock    ; None                        ; None                      ; 1.220 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|rxin           ; registrador:regrx|Q[7]                   ; clock      ; clock    ; None                        ; None                      ; 1.220 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|rxin           ; registrador:regrx|Q[1]                   ; clock      ; clock    ; None                        ; None                      ; 1.220 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|rxin           ; registrador:regrx|Q[2]                   ; clock      ; clock    ; None                        ; None                      ; 1.220 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|rxin           ; registrador:regrx|Q[3]                   ; clock      ; clock    ; None                        ; None                      ; 1.220 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[0]                   ; registrador:regrx|Q[2]                   ; clock      ; clock    ; None                        ; None                      ; 1.218 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[2]                   ; registrador:regrx|Q[3]                   ; clock      ; clock    ; None                        ; None                      ; 1.217 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[1]                   ; registrador:regri|Q[0]                   ; clock      ; clock    ; None                        ; None                      ; 1.202 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.jal1    ; controle:unidade_controle|pcsource[0]    ; clock      ; clock    ; None                        ; None                      ; 1.142 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.jal1    ; controle:unidade_controle|rxin           ; clock      ; clock    ; None                        ; None                      ; 1.140 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.jal1    ; controle:unidade_controle|pcsource[1]    ; clock      ; clock    ; None                        ; None                      ; 1.134 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|riin           ; registrador:regri|Q[0]                   ; clock      ; clock    ; None                        ; None                      ; 1.124 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.s1      ; controle:unidade_controle|pcin           ; clock      ; clock    ; None                        ; None                      ; 1.079 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.s1      ; controle:unidade_controle|pcsource[0]    ; clock      ; clock    ; None                        ; None                      ; 1.079 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.s1      ; controle:unidade_controle|riin           ; clock      ; clock    ; None                        ; None                      ; 1.075 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.s       ; controle:unidade_controle|riin           ; clock      ; clock    ; None                        ; None                      ; 1.042 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.s       ; controle:unidade_controle|rxin           ; clock      ; clock    ; None                        ; None                      ; 1.039 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.jal2    ; controle:unidade_controle|riin           ; clock      ; clock    ; None                        ; None                      ; 1.017 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.jal2    ; controle:unidade_controle|rxin           ; clock      ; clock    ; None                        ; None                      ; 1.015 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.jal2    ; controle:unidade_controle|pcsource[0]    ; clock      ; clock    ; None                        ; None                      ; 1.012 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.ret1    ; controle:unidade_controle|pcsource[1]    ; clock      ; clock    ; None                        ; None                      ; 1.005 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[4]                   ; registrador:regrx|Q[4]                   ; clock      ; clock    ; None                        ; None                      ; 0.986 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[3]                   ; registrador:regrx|Q[3]                   ; clock      ; clock    ; None                        ; None                      ; 0.981 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[6]                   ; registrador:regrx|Q[6]                   ; clock      ; clock    ; None                        ; None                      ; 0.979 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[5]                   ; registrador:regrx|Q[5]                   ; clock      ; clock    ; None                        ; None                      ; 0.971 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; registrador:regpc|Q[0]                   ; registrador:regri|Q[0]                   ; clock      ; clock    ; None                        ; None                      ; 0.965 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|estado.jal_ret ; controle:unidade_controle|estado.s       ; clock      ; clock    ; None                        ; None                      ; 0.961 ns                ;
; N/A   ; Restricted to 422.12 MHz ( period = 2.369 ns ) ; controle:unidade_controle|riin           ; controle:unidade_controle|riin           ; clock      ; clock    ; None                        ; None                      ; 0.956 ns                ;
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+-------+--------------+------------+---------------------------------------+-----------------+------------+


+---------------------------------------------------------------------------+
; tpd                                                                       ;
+-------+-------------------+-----------------+-----------+-----------------+
; Slack ; Required P2P Time ; Actual P2P Time ; From      ; To              ;
+-------+-------------------+-----------------+-----------+-----------------+
; N/A   ; None              ; 7.789 ns        ; aluout[1] ; regsourceout[1] ;
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; N/A   ; None              ; 7.266 ns        ; aluout[5] ; regsourceout[5] ;
+-------+-------------------+-----------------+-----------+-----------------+


+------------------------------------------------------------------------------------------------------+
; th                                                                                                   ;
+---------------+-------------+-----------+----------------+--------------------------------+----------+
; Minimum Slack ; Required th ; Actual th ; From           ; To                             ; To Clock ;
+---------------+-------------+-----------+----------------+--------------------------------+----------+
; N/A           ; None        ; -1.859 ns ; pcsourceout[3] ; registrador:regpc|Q[3]         ; clock    ;
; N/A           ; None        ; -1.870 ns ; pcsourceout[0] ; registrador:regpc|Q[0]         ; clock    ;
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; N/A           ; None        ; -1.993 ns ; pcsourceout[4] ; registrador:regpc|Q[4]         ; clock    ;
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; N/A           ; None        ; -2.721 ns ; aluout[2]      ; data_memory:dados|Read_data[1] ; clock    ;
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; N/A           ; None        ; -2.781 ns ; aluout[0]      ; data_memory:dados|Read_data[7] ; clock    ;
; N/A           ; None        ; -2.792 ns ; aluout[5]      ; data_memory:dados|Read_data[7] ; clock    ;
; N/A           ; None        ; -2.898 ns ; aluout[1]      ; data_memory:dados|Read_data[0] ; clock    ;
; N/A           ; None        ; -3.005 ns ; aluout[0]      ; data_memory:dados|Read_data[0] ; clock    ;
; N/A           ; None        ; -3.005 ns ; aluout[0]      ; data_memory:dados|Read_data[1] ; clock    ;
; N/A           ; None        ; -3.011 ns ; aluout[2]      ; data_memory:dados|Read_data[0] ; clock    ;
; N/A           ; None        ; -3.012 ns ; aluout[1]      ; data_memory:dados|Read_data[7] ; clock    ;
; N/A           ; None        ; -3.143 ns ; aluout[6]      ; data_memory:dados|Read_data[1] ; clock    ;
; N/A           ; None        ; -3.203 ns ; aluout[3]      ; data_memory:dados|Read_data[1] ; clock    ;
; N/A           ; None        ; -3.204 ns ; aluout[2]      ; data_memory:dados|Read_data[7] ; clock    ;
; N/A           ; None        ; -3.239 ns ; aluout[7]      ; data_memory:dados|Read_data[1] ; clock    ;
; N/A           ; None        ; -3.304 ns ; aluout[5]      ; data_memory:dados|Read_data[1] ; clock    ;
; N/A           ; None        ; -3.332 ns ; aluout[3]      ; data_memory:dados|Read_data[7] ; clock    ;
; N/A           ; None        ; -3.407 ns ; aluout[4]      ; data_memory:dados|Read_data[1] ; clock    ;
; N/A           ; None        ; -3.433 ns ; aluout[6]      ; data_memory:dados|Read_data[0] ; clock    ;
; N/A           ; None        ; -3.493 ns ; aluout[3]      ; data_memory:dados|Read_data[0] ; clock    ;
; N/A           ; None        ; -3.529 ns ; aluout[7]      ; data_memory:dados|Read_data[0] ; clock    ;
; N/A           ; None        ; -3.594 ns ; aluout[5]      ; data_memory:dados|Read_data[0] ; clock    ;
; N/A           ; None        ; -3.697 ns ; aluout[4]      ; data_memory:dados|Read_data[0] ; clock    ;
+---------------+-------------+-----------+----------------+--------------------------------+----------+


+--------------------------+
; Timing Analyzer Messages ;
+--------------------------+
Info: *******************************************************************
Info: Running Quartus II Classic Timing Analyzer
    Info: Version 6.1 Build 201 11/27/2006 SJ Web Edition
    Info: Processing started: Sun Jun 10 17:31:12 2007
Info: Command: quartus_tan --read_settings_files=off --write_settings_files=off cpu1 -c cpu1 --timing_analysis_only
Warning: Found pins functioning as undefined clocks and/or memory enables
    Info: Assuming node "clock" is an undefined clock
Info: Clock "clock" Internal fmax is restricted to 422.12 MHz between source register "controle:unidade_controle|rxin" and destination register "registrador:regrx|Q[0]"
    Info: fmax restricted to clock pin edge rate 2.369 ns. Expand message to see actual delay path.
        Info: + Longest register to register delay is 1.784 ns
            Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LC_X45_Y5_N3; Fanout = 9; REG Node = 'controle:unidade_controle|rxin'
            Info: 2: + IC(1.079 ns) + CELL(0.705 ns) = 1.784 ns; Loc. = LC_X46_Y3_N4; Fanout = 2; REG Node = 'registrador:regrx|Q[0]'
            Info: Total cell delay = 0.705 ns ( 39.52 % )
            Info: Total interconnect delay = 1.079 ns ( 60.48 % )
        Info: - Smallest clock skew is 0.011 ns
            Info: + Shortest clock path from clock "clock" to destination register is 2.975 ns
                Info: 1: + IC(0.000 ns) + CELL(0.828 ns) = 0.828 ns; Loc. = PIN_M20; Fanout = 32; CLK Node = 'clock'
                Info: 2: + IC(1.605 ns) + CELL(0.542 ns) = 2.975 ns; Loc. = LC_X46_Y3_N4; Fanout = 2; REG Node = 'registrador:regrx|Q[0]'
                Info: Total cell delay = 1.370 ns ( 46.05 % )
                Info: Total interconnect delay = 1.605 ns ( 53.95 % )
            Info: - Longest clock path from clock "clock" to source register is 2.964 ns
                Info: 1: + IC(0.000 ns) + CELL(0.828 ns) = 0.828 ns; Loc. = PIN_M20; Fanout = 32; CLK Node = 'clock'
                Info: 2: + IC(1.594 ns) + CELL(0.542 ns) = 2.964 ns; Loc. = LC_X45_Y5_N3; Fanout = 9; REG Node = 'controle:unidade_controle|rxin'
                Info: Total cell delay = 1.370 ns ( 46.22 % )
                Info: Total interconnect delay = 1.594 ns ( 53.78 % )
        Info: + Micro clock to output delay of source is 0.156 ns
        Info: + Micro setup delay of destination is 0.010 ns
Info: tsu for register "data_memory:dados|Read_data[0]" (data pin = "aluout[4]", clock pin = "clock") is 3.807 ns
    Info: + Longest pin to register delay is 6.687 ns
        Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = PIN_K8; Fanout = 1; PIN Node = 'aluout[4]'
        Info: 2: + IC(0.000 ns) + CELL(1.087 ns) = 1.087 ns; Loc. = IOC_X33_Y31_N5; Fanout = 3; COMB Node = 'aluout[4]~3'
        Info: 3: + IC(4.006 ns) + CELL(0.366 ns) = 5.459 ns; Loc. = LC_X36_Y30_N9; Fanout = 1; COMB Node = 'data_memory:dados|Mux7~1052'
        Info: 4: + IC(0.301 ns) + CELL(0.280 ns) = 6.040 ns; Loc. = LC_X36_Y30_N7; Fanout = 2; COMB Node = 'data_memory:dados|Mux7~1054'
        Info: 5: + IC(0.328 ns) + CELL(0.319 ns) = 6.687 ns; Loc. = LC_X36_Y30_N2; Fanout = 4; REG Node = 'data_memory:dados|Read_data[0]'
        Info: Total cell delay = 2.052 ns ( 30.69 % )
        Info: Total interconnect delay = 4.635 ns ( 69.31 % )
    Info: + Micro setup delay of destination is 0.010 ns
    Info: - Shortest clock path from clock "clock" to destination register is 2.890 ns
        Info: 1: + IC(0.000 ns) + CELL(0.828 ns) = 0.828 ns; Loc. = PIN_M20; Fanout = 32; CLK Node = 'clock'
        Info: 2: + IC(1.520 ns) + CELL(0.542 ns) = 2.890 ns; Loc. = LC_X36_Y30_N2; Fanout = 4; REG Node = 'data_memory:dados|Read_data[0]'
        Info: Total cell delay = 1.370 ns ( 47.40 % )
        Info: Total interconnect delay = 1.520 ns ( 52.60 % )
Info: tco from clock "clock" to destination pin "pcsourceout[7]" through register "registrador:regpc|Q[1]" is 9.800 ns
    Info: + Longest clock path from clock "clock" to source register is 2.964 ns
        Info: 1: + IC(0.000 ns) + CELL(0.828 ns) = 0.828 ns; Loc. = PIN_M20; Fanout = 32; CLK Node = 'clock'
        Info: 2: + IC(1.594 ns) + CELL(0.542 ns) = 2.964 ns; Loc. = LC_X46_Y5_N8; Fanout = 6; REG Node = 'registrador:regpc|Q[1]'
        Info: Total cell delay = 1.370 ns ( 46.22 % )
        Info: Total interconnect delay = 1.594 ns ( 53.78 % )
    Info: + Micro clock to output delay of source is 0.156 ns
    Info: + Longest register to pin delay is 6.680 ns
        Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = LC_X46_Y5_N8; Fanout = 6; REG Node = 'registrador:regpc|Q[1]'
        Info: 2: + IC(0.408 ns) + CELL(0.451 ns) = 0.859 ns; Loc. = LC_X46_Y5_N1; Fanout = 3; COMB Node = 'alu:pcadd|Add0~123COUT1'
        Info: 3: + IC(0.000 ns) + CELL(0.060 ns) = 0.919 ns; Loc. = LC_X46_Y5_N2; Fanout = 3; COMB Node = 'alu:pcadd|Add0~125COUT1'
        Info: 4: + IC(0.000 ns) + CELL(0.060 ns) = 0.979 ns; Loc. = LC_X46_Y5_N3; Fanout = 3; COMB Node = 'alu:pcadd|Add0~127COUT1'
        Info: 5: + IC(0.000 ns) + CELL(0.118 ns) = 1.097 ns; Loc. = LC_X46_Y5_N4; Fanout = 6; COMB Node = 'alu:pcadd|Add0~115'
        Info: 6: + IC(0.000 ns) + CELL(0.449 ns) = 1.546 ns; Loc. = LC_X46_Y5_N7; Fanout = 4; COMB Node = 'alu:pcadd|Add0~120'
        Info: 7: + IC(1.483 ns) + CELL(0.075 ns) = 3.104 ns; Loc. = LC_X46_Y3_N2; Fanout = 1; COMB Node = 'mux3x1:muxpcsource|Mux10~102'
        Info: 8: + IC(1.172 ns) + CELL(2.404 ns) = 6.680 ns; Loc. = PIN_Y7; Fanout = 0; PIN Node = 'pcsourceout[7]'
        Info: Total cell delay = 3.617 ns ( 54.15 % )
        Info: Total interconnect delay = 3.063 ns ( 45.85 % )
Info: Longest tpd from source pin "aluout[1]" to destination pin "regsourceout[1]" is 7.789 ns
    Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = PIN_E8; Fanout = 1; PIN Node = 'aluout[1]'
    Info: 2: + IC(0.000 ns) + CELL(1.087 ns) = 1.087 ns; Loc. = IOC_X41_Y31_N2; Fanout = 3; COMB Node = 'aluout[1]~6'
    Info: 3: + IC(4.298 ns) + CELL(2.404 ns) = 7.789 ns; Loc. = PIN_G8; Fanout = 0; PIN Node = 'regsourceout[1]'
    Info: Total cell delay = 3.491 ns ( 44.82 % )
    Info: Total interconnect delay = 4.298 ns ( 55.18 % )
Info: th for register "registrador:regpc|Q[3]" (data pin = "pcsourceout[3]", clock pin = "clock") is -1.859 ns
    Info: + Longest clock path from clock "clock" to destination register is 2.964 ns
        Info: 1: + IC(0.000 ns) + CELL(0.828 ns) = 0.828 ns; Loc. = PIN_M20; Fanout = 32; CLK Node = 'clock'
        Info: 2: + IC(1.594 ns) + CELL(0.542 ns) = 2.964 ns; Loc. = LC_X47_Y5_N6; Fanout = 5; REG Node = 'registrador:regpc|Q[3]'
        Info: Total cell delay = 1.370 ns ( 46.22 % )
        Info: Total interconnect delay = 1.594 ns ( 53.78 % )
    Info: + Micro hold delay of destination is 0.100 ns
    Info: - Shortest pin to register delay is 4.923 ns
        Info: 1: + IC(0.000 ns) + CELL(0.000 ns) = 0.000 ns; Loc. = PIN_Y6; Fanout = 1; PIN Node = 'pcsourceout[3]'
        Info: 2: + IC(0.000 ns) + CELL(1.087 ns) = 1.087 ns; Loc. = IOC_X46_Y0_N0; Fanout = 1; COMB Node = 'pcsourceout[3]~4'
        Info: 3: + IC(3.751 ns) + CELL(0.085 ns) = 4.923 ns; Loc. = LC_X47_Y5_N6; Fanout = 5; REG Node = 'registrador:regpc|Q[3]'
        Info: Total cell delay = 1.172 ns ( 23.81 % )
        Info: Total interconnect delay = 3.751 ns ( 76.19 % )
Info: Quartus II Classic Timing Analyzer was successful. 0 errors, 1 warning
    Info: Allocated 99 megabytes of memory during processing
    Info: Processing ended: Sun Jun 10 17:31:13 2007
    Info: Elapsed time: 00:00:01


